AD9633BCPZ-105

El AD9633 es un ADC cuádruple de 12 bits y 105MSPS con un circuito de muestreo y retención en chip diseñado para ofrecer bajo coste, bajo consumo, tamaño reducido y facilidad de uso. El ADC necesita una única fuente de alimentación de 1,8 V y un reloj de frecuencia de muestreo compatible con LVPECL-/ CMOS-/LVDS para funcionar a pleno rendimiento. En muchas aplicaciones no se necesitan componentes de referencia o controladores externos. El ADC multiplica automáticamente el reloj de frecuencia de muestreo para la velocidad de datos serie LVDS adecuada. Se ofrece una salida de reloj de datos (DCO) para capturar datos en la salida y una salida de reloj de trama (FCO) para señalar un nuevo byte de salida. Entre sus aplicaciones típicas figuran los ultrasonidos médicos, la obtención de imágenes a alta velocidad, los receptores de radio en cuadratura y diversidad y los equipos de prueba.

• SNR de 71 dB (a Nyquist) y SFDR de 91 dBc (a Nyquist)
• DNL de ±0,3 LSB (típico) e INL de ±0,5 LSB (típico)
• LVDS serie (ANSI-644, por defecto) y bajo consumo, opción de señal reducida (similar a IEEE 1596.3)
• Ancho de banda analógico de 650 MHz a plena potencia
• Rango de tensión de entrada de 2 V p-p
• Control de puerto serie (modos de apagado completo del chip y de canal individual, orientación flexible de bits)
• Generación de patrones de prueba digitales integrados y personalizados y sincronización multichip y divisor de reloj
• Reloj de salida y alineación de datos programables, resolución de salida programable y modo de espera
• Encapsulado LFCSP de 48 terminales
• Rango de temperatura de funcionamiento de -40°C a 85°C

Notas

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