AD9511BCPZ-REEL7

AD9511 es un CI de distribución de reloj de 1,2 GHz, núcleo PLL, divisor, ajuste de retardo, cinco salidas. Ofrece una función de distribución de reloj multisalida junto con un núcleo PLL en chip. El diseño hace hincapié en un bajo nivel de fluctuación y ruido de fase para maximizar el rendimiento del convertidor de datos. Otras aplicaciones con requisitos exigentes de ruido de fase y fluctuación de fase también se benefician de esta pieza. La sección PLL consta de un divisor de referencia programable (R); un detector de frecuencia de fase (PFD) de bajo ruido, una bomba de carga de precisión y un divisor de realimentación programable. Conectando un VCXO o VCO externo a los pines CLK2/CLK2B, se pueden sincronizar frecuencias de hasta 1,6GHz con la referencia de entrada. Hay cinco salidas de reloj independientes. La aplicación incluye distribución de reloj de baja fluctuación y bajo ruido de fase, sincronización de ADC de alta velocidad, DAC, DDS, DDC, DUC, MxFE, transceptores inalámbricos de alto rendimiento, instrumentación de alto rendimiento, infraestructura de banda ancha.

• Núcleo de bucle de enganche de fase de bajo ruido de fase, frecuencias de entrada de referencia de hasta 250 MHz
• Preescalador de doble módulo programable, corriente de bomba de carga (CP) programable
• La alimentación CP independiente (VCPS) amplía el rango de sintonización
• Dos entradas de reloj diferencial de 1,6 GHz, 5 divisores programables, de 1 a 32, todos enteros
• Selección de fase para ajuste de retardo grueso de salida a salida
• Ajuste fino del retardo en 1 salida LVDS/CMOS, puerto de control serie
• Rango de frecuencia de entrada de 0MHz a 250MHz (VS = 3,3V ± 5%, TA = 25°C)
• 4,8mA valor alto típico (Con CPRSET = 5,1Kohm, TA = 25°C)
• Precisión absoluta típica del 2,5% (VCP = VCPS/2, VS = 3,3V ± 5%, TA = 25°C)
• Encapsulado LFCSP de 48 terminales, rango de temperatura de funcionamiento de -40°C a 85°C

Notas

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