AD9250BCPZ-250

El AD9250 es un ADC dual de 14 bits con velocidades de muestreo de hasta 250MSPS diseñado para soportar aplicaciones de comunicaciones en las que se busca bajo coste, pequeño tamaño, gran ancho de banda y versatilidad. El núcleo del ADC presenta una arquitectura multietapa diferencial canalizada con lógica de corrección de errores de salida integrada. Una referencia de tensión integrada facilita el diseño. Se ofrece un estabilizador del ciclo de trabajo para compensar las variaciones en el ciclo de trabajo del reloj del ADC, lo que permite a los convertidores mantener un rendimiento excelente. Las aplicaciones típicas incluyen sistemas de radio de diversidad, receptores digitales multimodo (3G) (TD-SCDMA, WiMAX, W-CDMA, CDMA2000, GSM, EDGE, LTE), rutas de recepción ascendentes CMTS DOCSIS 3,0, receptores de ruta inversa digital HFC, sistemas de demodulación I/Q, sistemas de antenas inteligentes, equipos electrónicos de test y medida, receptores de radar, arquitecturas de radio COMSEC, sistemas de detección/jamming de IED, radios de software de uso general y aplicaciones de datos de banda ancha.

• Tensión de alimentación de 1,8V
• Relación señal/ruido (SNR) = 70,6dBFS a 185MHz AIN y 250MSPS
• Rango dinámico libre de espurias (SFDR) = 88dBc a 185MHz AIN y 250MSPS
• Divisor de reloj de entrada entera de 1 a 8 y frecuencias de muestreo de IF de hasta 400 MHz
• Referencia de tensión interna del convertidor analógico-digital (ADC)
• Rango de entrada analógica flexible de 1,4 Vp-p a 2 Vp-p (1,75 V p-p nominal)
• Estabilizador del ciclo de trabajo del reloj del ADC, aislamiento/cortes transversales de canal de 95 dB y ancho de banda de potencia total de 1.000 MHz
• Control del puerto serie y modos de apagado para ahorrar energía
• Encapsulado LFCSP de 48 terminales
• Rango de temperatura de funcionamiento de -40°C a 85°C

Notas

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