AD9204BCPZ-80

AD9204 es un ADC monolítico de doble canal y 80MSPS. Incorpora un circuito de muestreo y retención de alto rendimiento y una referencia de tensión en el chip. El ADC contiene varias funciones diseñadas para maximizar la flexibilidad y minimizar el coste del sistema, como la alineación programable de reloj y datos y la generación de patrones de prueba digitales programables. Los patrones de prueba digitales disponibles incluyen patrones deterministas y pseudoaleatorios incorporados, junto con patrones de prueba personalizados definidos por el usuario introducidos a través de la SPI. Una entrada de reloj diferencial controla todos los ciclos de conversión internos. Un estabilizador del ciclo de trabajo (DCS) opcional compensa las grandes variaciones en el ciclo de trabajo del reloj manteniendo un excelente rendimiento general del ADC. Las aplicaciones típicas incluyen comunicaciones, sistemas de radio de diversidad, receptores digitales multimodo (GSM, EDGE, W-CDMA, LTE, CDMA2000, WiMAX, TD-SCDMA), sistemas de demodulación I/Q, sistemas de antenas inteligentes, instrumentos alimentados por baterías, medidores portátiles de alcance, ultrasonidos, Radar/LIDAR e imágenes PET/SPECT.

• Alimentación analógica de 1,8 V y alimentación de salida de 1,8 V a 3,3 V
• SNR de 61,3 dBFS a 9,7 MHz de entrada y 61 dBFS a 200 MHz de entrada
• SFDR de 75 dBc a 9,7 MHz de entrada y 73 dBc a 200 MHz de entrada
• 37 mW en modo de espera y 2,2 mW en modo de desconexión
• Entrada diferencial con un ancho de banda de 700MHz
• Referencia de tensión en chip y circuito de muestreo y retención
• Entrada analógica escalable de 1 V p-p a 2 V p-p diferencial y estabilizador opcional del ciclo de trabajo del reloj
• Formato de datos binario offset, código Gray o complemento a dos y modos de apagado de bajo consumo
• Divisor de reloj de entrada 1 a 8 y salida de reloj de datos con reloj y datos programables
• Encapsulado LFCSP-EP de 64 terminales, rango de temperatura de funcionamiento de -40°C a 85°C

Notas

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